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Low Computation Cycle and High Speed Recursive DFT/IDFT: VLSI Algorithm and Architecture

机译：低计算周期和高速递归DFT / IDFT：VLSI算法和体系结构

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2. A Low-Cost, Low-Complexity, and Memory-Free Architecture of Novel Recursive DFT and IDFT Algorithms for DTMF Application [J] . Lai S.-C., Lei S.-F., Juang W.-H., Circuits and Systems II: Express Briefs, IEEE Transactions on . 2010,第9期

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3. A Lower Power, Low Complexity And Memory Free Implementation Of Novel Recursive DFT And IDFT Algorithms [J] . Afroz Ali Shaik, U Yedukondalu International Journal of Engineering Research and Applications . 2013,第4期

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4. Low computation cycle and high speed recursive DFT/IDFT: VLSI algorithm and architecture [C] . Van, L.-D., Yuan-Chu Yu, . 2005

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5. Low-power and high-speed algorithms and VLSI architectures for error control coding and adaptive video scaling. [D] . Raghupathy, Arun. 1998

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6. An Efficient VLSI Architecture for Multi-Channel Spike Sorting Using a Generalized Hebbian Algorithm [O] . Ying-Lun Chen, Wen-Jyi Hwang, Chi-En Ke 2015

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7. High-Speed Area-Efficient Recursive DFT/IDFT Architecturesʳ [O] . Lan-da Van, Chih-chyau Yang 2014

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8. DFT Algorithms for Bit-Serial GaAs Array Processor Architectures [R] . McMillan, G. B. 1988

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